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DS28CZ04: 4Kb I2C/SMBus EEPROM with Nonvolatile PIO
BIT DESCRIPTION
OV0: Output Value of
PIO0
OV1: Output Value of
PIO1
OV2: Output Value of
PIO2
OV3: Output Value of
PIO3
IV0: Input Value of PIO0
IV1: Input Value of PIO1
IV2: Input Value of PIO2
IV3: Input Value of PIO3
BIT(S)
?
?
?
?
?
?
?
?
DEFINITION
Logic output state of PIO0 if DIR0 = 0 (output)
Logic output state of PIO1 if DIR1 = 0 (output)
Logic output state of PIO2 if DIR2 = 0 (output)
Logic output state of PIO3 if DIR3 = 0 (output)
Logic state read from PIO0 XOR’ed with IMSK0
Logic state read from PIO1 XOR’ed with IMSK1
Logic state read from PIO2 XOR’ed with IMSK2
Logic state read from PIO3 XOR’ed with IMSK3
Figure 3 shows a simplified schematic of a PIO. The flip flops are accessed through the PIO R/W Access Registers
and memory addresses 7Ah and 7Bh (Device Address = A0h). They are initialized at power-up or during reset
according to the data stored at memory addresses 76h and 77h (Device Address = A0h). When a PIO is configured
as input, the PIO output is tri-stated (high impedance). When a PIO is configured as output, the PIO input is the
same as the output state XOR'ed with the corresponding read inversion bit.
Figure 3. PIO Simplified Schematic
OTn
OTn
from Serial Interface
D
Q
Note : OTn, DIRn, OVn and IMSKn are
nonvolatile based on power-on register
CLK
values (memory addresses 76h and 77h,
device address A0h)
DIRn
from Serial Interface
DIRn
D
Q
Vcc
CLK
PIOn Pin
OVn
OVn
from Serial Interface
D
Q
CLK
CLK
IMSKn
from Serial Interface
IMSKn
D Q
CLK
IVn
D Q
CLK
to Serial Interface
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